老虎說芯

“老虎說芯”由北京大學微電子專業(yè)本碩，中國電源學會會員、在半導體行業(yè)有10多年經(jīng)驗的胡獨巍先生撰寫，為大家提供半導體行業(yè)關(guān)于材料、工藝、應用、市場、資訊等方面的內(nèi)容。在知乎有同名賬號。

如何看待美國對華半導體企業(yè)進行出口限制事件？

更新日期： 2024-12-09
瀏覽次數(shù)： 1251

近期，美國擬對中國半導體設(shè)備公司進行出口限制，是全球科技競爭中一項具有重要地緣戰(zhàn)略和經(jīng)濟意義的措施。 1. 美國對華出口限制的背景 1.1 地緣政治背景科技冷戰(zhàn)升級：近年來，中美競爭加劇，尤其在科技領(lǐng)域。半導體作為信息技術(shù)的基礎(chǔ)，關(guān)系到國家安全、經(jīng)濟競爭力和軍事技術(shù)發(fā)展。制約中國技術(shù)崛起：美……

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多芯片封裝（MCP）的全面解析

更新日期： 2024-12-09
瀏覽次數(shù)： 1543

多芯片封裝技術(shù)（Multi-Chip Packaging, MCP）是現(xiàn)代集成電路（IC）領(lǐng)域的一項關(guān)鍵技術(shù)，用于在一個封裝中集成多個芯片或功能單元。這項技術(shù)通過空間的優(yōu)化和功能的協(xié)同，大幅提升了器件的性能、帶寬及能源效率，是未來高性能計算、人工智能、通信等領(lǐng)域的核心基礎(chǔ)。 1. 多芯片封裝的基本概念 1.……

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晶圓（wafer）/晶粒（die）/芯片（chip）之間的區(qū)別和聯(lián)系

更新日期： 2024-11-21
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1. 晶圓（Wafer）——原材料和生產(chǎn)平臺晶圓是半導體制造的基礎(chǔ)材料，通常由高純度的硅（Si）或其他半導體材料制成。晶圓的形狀一般是圓形的薄片，厚度一般在幾百微米到幾毫米之間，表面經(jīng)過精密的處理，使其足夠光滑，并具備優(yōu)良的晶體結(jié)構(gòu)，適合進行各種電子器件的加工。比喻：可以把晶圓比作“原材料”或“紙張”，……

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為什么大廠不愿意使用英偉達的NVLink？

更新日期： 2024-11-21
瀏覽次數(shù)： 1081

在當前的GPU和加速計算領(lǐng)域，英偉達（NVIDIA）無疑是領(lǐng)先的技術(shù)提供者，其開發(fā)的NVLink技術(shù)是一項革命性的高速互連技術(shù)，旨在加速GPU之間以及GPU與主機CPU之間的通信。然而，盡管NVLink技術(shù)具有顯著的優(yōu)勢，許多大廠仍然選擇不采用這一技術(shù)，而是使用其他技術(shù)或開發(fā)自己的互連方案。那么，是什么原因使得這些廠商……

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芯片測試程序

更新日期： 2024-11-12
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一、測試程序的基本概念測試程序，即被ATE（Automatic Test Equipment，自動測試設(shè)備）識別和執(zhí)行的指令集，是集成電路測試的核心。測試程序的主要功能是指引ATE在測試中如何與被測器件（DUT）交互，具體包括如何對DUT施加不同的輸入激勵，如何測量其響應信號，以及將測量結(jié)果與設(shè)定的門限值（Li……

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如何理解芯片測試中的DUT？

更新日期： 2024-11-12
瀏覽次數(shù)： 1858

理解并深入掌握DUT（Device Under Test，被測器件）在集成電路測試中的概念是非常關(guān)鍵的，因為DUT是整個測試過程中直接與ATE（自動化測試設(shè)備）交互的對象。 1. DUT的定義和作用 DUT，即被測器件，指在測試過程中被測量、分析或驗證性能的集成電路或電子組件。在集成電路測試領(lǐng)域，DUT通常……

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中芯國際2024年第三季度表現(xiàn)如何？

更新日期： 2024-11-12
瀏覽次數(shù)： 1007

中芯國際2024年第三季度的業(yè)績表現(xiàn)總體符合預期，并且在多個方面表現(xiàn)超出市場預期。我們可以從以下幾個方面進行詳細分析： 1. 財務表現(xiàn) 營收：第三季度營收達到21.7億美元，同比增長34%，環(huán)比增長14.2%，符合公司給出的指引范圍（13%-15%）。毛利率：毛利率達到了20.5%，超出了預期的18……

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臺積電在2024年第三季度的表現(xiàn)如何？

更新日期： 2024-11-12
瀏覽次數(shù)： 1224

臺積電在2024年第三季度的表現(xiàn)相當亮眼，各項指標超出預期，展現(xiàn)了其在全球半導體行業(yè)中的領(lǐng)導地位和前沿技術(shù)的優(yōu)勢。以下是對其24Q3業(yè)績的詳細解讀：一、財務表現(xiàn) 營收：臺積電在Q3實現(xiàn)凈營收7596.9億新臺幣，環(huán)比增長12.8%，同比增長39.0%。若以美元計，營收達235億美元，超出此前指引的上限，顯……

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版圖設(shè)計是一門技術(shù)，也是一門藝術(shù)

更新日期： 2024-10-31
瀏覽次數(shù)： 1214

我們可以將集成電路版圖設(shè)計比作城市規(guī)劃和建筑設(shè)計的結(jié)合。就像在有限的土地上規(guī)劃建筑和道路布局一樣，版圖設(shè)計需要在有限的芯片空間上安排晶體管、布線和各類元件，以實現(xiàn)功能和性能的最大化。一、什么是版圖設(shè)計？版圖設(shè)計是將電路的邏輯功能通過物理層次實現(xiàn)出來的過程。它類似于建筑圖紙的設(shè)計工作，需要通過EDA工具（……

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如何在晶圓上生長二氧化硅（SiO2）

更新日期： 2024-10-31
瀏覽次數(shù)： 1668

氧化工藝在CMOS集成電路制造中是一個非常重要的步驟，用于在硅片（Si wafer）表面生長二氧化硅（SiO2）。生長SiO2的過程可以類比為給硅片“穿上一層保護外衣”，這種外衣可以起到絕緣、防護和隔離等作用。 1. 準備基材（硅片）首先，需要準備一塊高純度的硅片。這就像在一張空白的畫布上進行繪畫，硅片是……

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閑聊低電壓模擬芯片設(shè)計技巧

更新日期： 2024-10-31
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低電壓模擬電路設(shè)計技術(shù)的核心是要在盡可能低的電源電壓下，實現(xiàn)高效的模擬信號處理。這種設(shè)計思路主要受到移動設(shè)備、植入式醫(yī)療設(shè)備等應用場景的需求驅(qū)動。由于這些設(shè)備的空間和能量資源有限，工程師們需要找到能夠在低電壓（如3V以下）下高效工作的電路設(shè)計方法。 1. 技術(shù)選擇與工藝背景低電壓設(shè)計首先受到半導體工藝的限……

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EMMI在半導體器件失效分析的重要性

更新日期： 2024-10-24
瀏覽次數(shù)： 1222

失效分析的目的是通過技術(shù)手段找出器件失效的根本原因，并推動改進措施的實施，從而提升生產(chǎn)工藝、改善產(chǎn)品質(zhì)量、提高良率和可靠性。EMMI是在失效分析過程中經(jīng)常使用的設(shè)備之一，它們能夠幫助分析人員檢測電氣故障，并定位失效的具體位置。 1. EMMI的基本原理 EMMI（Electro-Magnetic Induc……

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